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在进行接收容限测试时，需要用到多通道的误码仪产生带压力的DQ、DQS等信号。测 试 中 被 测 件 工 作 在 环 回 模 式 ， D Q 引 脚 接 收 的 数 据 经 被 测 件 转 发 并 通 过 L B D 引 脚 输 出 到 误码仪的误码检测端口。在测试前需要用示波器对误码仪输出的信号进行校准，如DQS与 DQ的时延校准、信号幅度校准、DCD与RJ抖动校准、压力眼校准、均衡校准等。图5.21 展示了一整套DDR5接收端容限测试的环境。

DDR4/5的协议测试

除了信号质量测试以外，有些用户还会关心DDR总线上真实读/写的数据是否正确， 以及总线上是否有协议的违规等，这时就需要进行相关的协议测试。DDR的总线宽度很  宽，即使数据线只有16位，加上地址、时钟、控制信号等也有30多根线，更宽位数的总线甚  至会用到上百根线。为了能够对这么多根线上的数据进行同时捕获并进行协议分析，适  合的工具就是逻辑分析仪。DDR协议测试的基本方法是通过相应的探头把被测信号引到  逻辑分析仪，在逻辑分析仪中运行解码软件进行协议验证和分析。 DDR4 一致性测试软件；HDMI测试DDR一致性测试价格优惠

为了进行更简单的读写分离，Agilent的Infiniium系列示波器提供了一种叫作InfiniiScan 的功能，可以通过区域（Zone）定义的方式把读写数据可靠分开。

根据读写数据的建立保持时间不同，Agilent独有的InfiniiScan功能可以通过在屏幕上画 出几个信号必须通过的区域的方式方便地分离出读、写数据，并进一步进行眼图的测试。

信号的眼图。用同样的方法可以把读信号的眼图分离出来。

除了形成眼图外，我们还可以利用示波器的模板测量功能对眼图进行定量分析，

用户可以根据JEDEC的要求自行定义一个模板对读、写信号进行模板测试，如 果模板测试Fail,则还可以利用Agilent示波器提供的模板定位功能定位到引起Fail的波形段。 广西解决方案DDR一致性测试什么是DDR DDR2 DDR3 DDR4 DDR5;

前面介绍过，JEDEC规范定义的DDR信号的要求是针对DDR颗粒的引脚上的，但 是通常DDR芯片采用BGA封装，引脚无法直接测试到。即使采用了BGA转接板的方 式，其测试到的信号与芯片引脚处的信号也仍然有一些差异。为了更好地得到芯片引脚 处的信号质量， 一种常用的方法是在示波器中对PCB走线和测试夹具的影响进行软件的 去嵌入(De-embedding)操作。去嵌入操作需要事先知道整个链路上各部分的S参数模型 文件(通常通过仿真或者实测得到),并根据实际测试点和期望观察到的点之间的传输函数， 来计算期望位置处的信号波形，再对这个信号做进一步的波形参数测量和统计。展示了典型的DDR4和DDR5信号质量测试环境，以及在示波器中进行去嵌入操作的 界面。

DDR地址、命令总线的一致性测试

DDR的地址、命令总线的信号完整性测试主要测试其波形和时序参数。地址总线An、 命令总线/RAS、/CAS、/WE、/CS需要测试的信号品质主要包括：Vmax （最大电压值）；Vmin （小电压值）；Overshoot （过冲）和Undershoot （下冲）的持续时间的大值；Slew Rate （斜率）；Ringback （回沟）等。还需要测试相对于时钟边沿的Setup Time （建立时间）和Hold Time （保持时间）。建立时间和保持时间的定义如图7.134所示，其中加为建立时间，如为 保持时间，针对DDR400,加和如为0.7ns。

DDR原理及物理层一致性测试；

对DDR5来说，设计更为复杂，仿真软件需要帮助用户通过应用IBIS模型针对基于 DDR5颗粒或DIMM的系统进行仿真验证，比如仿真驱动能力、随机抖动/确定性抖动、寄 生电容、片上端接ODT、信号上升/下降时间、AGC(自动增益控制)功能、4taps DFE(4抽头 判决反馈均衡)等。

DDR的读写信号分离

对于DDR总线来说，真实总线上总是读写同时存在的。规范对于读时序和写时序的 相关时间参数要求是不一样的，读信号的测量要参考读时序的要求，写信号的测量要参考写 时序的要求。因此要进行DDR信号的测试，第一步要做的是从真实工作的总线上把感兴 趣的读信号或者写信号分离出来。JEDEC协会规定的DDR4总线的 一个工作时 序图(参考资料： JEDEC STANDARD DDR4 SDRAM,JESD79-4),可以看到对于读和写信 号来说，DQS和DQ间的时序关系是不一样的。 DDR测试信号问题排查；HDMI测试DDR一致性测试价格优惠

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DDR-致性测试探测和夹具

DDR的信号速率都比较高，要进行可靠的测量，通常推荐的探头连接方式是使用焊接式 探头。还有许多很难在PCB板上找到相应的测试焊盘的情况（比如釆用盲埋孔或双面BGA 焊接的情况），所以Agilent还提供了不同种类的BGA探头，通过对板子做重新焊接将BGA 的Adapter焊接在DDR的memory chip和PCB板中间，并将信号引出。DDR3的 BGA探头的焊接例子。

DDR是需要进行信号完整性测试的总线中复杂的总线，不仅走线多、探测困难，而且 时序复杂，各种操作交织在一起。本文分别从时钟、地址、命令、数据总线方面介绍信号完 整性一致性测试的一些要点和方法，也介绍了自动化测试软件和测试夹具,但是真正测试DDR 总线仍然是一件比较有挑战的事情。 HDMI测试DDR一致性测试价格优惠