采用串行总线以后,就单根线来说,由于上面要传输原来多根线传输的数据,所以其工作速率一般要比相应的并行总线高很多。比如以前计算机上的扩展槽上使用的PCI总线采用并行32位的数据线,每根数据线上的数据传输速率是33Mbps,演变到PCle(PCI-express)的串行版本后每根线上的数据速率至少是2.5Gbps(PCIel.0代标准),现在PCIe的数据速率已经达到了16Gbps(PCIe4.0代标准)或32Gbps(PCIe5.0代标准)。采用串行总线的另一个好处是在提高数据传输速率的同时节省了布线空间,芯片的功耗也降低了,所以在现代的电子设备中,当需要进行高速数据传输时,使用串行总线的越来越多。
数据速率提高以后,对于阻抗匹配、线路损耗和抖动的要求就更高,稍不注意就很容易产生信号质量的问题。图1.10是一个典型的1Gbps的信号从发送端经过芯片封装、PCB、连接器、背板传输到接收端的信号路径,可以看到在发送端的接近理想的0、1跳变的数字信号到达接收端后由于高频损耗、反射等的影响,信号波形已经变得非常恶劣,所以串行总线的设计对于数字电路工程师来说是一个很大的挑战。 数字信号的波形分析(Waveform Analysis);海南数字信号测试价目表

采用同步时钟的电路减少了出现逻辑不确定状态的可能性,而且可以减小电路和信号布线时延的累积效应,所以在现代的数字系统和设备中***采用。采用同步电路以后,数字电路就以一定的时钟节拍工作,我们把数字信号每秒钟跳变的比较大速率称为信号的数据速率(BitRate),单位通常是bps(bitspersecond)或者bit/s。大部分并行总线的数据速率和系统中时钟的工作频率一致,比如某51系列单片机工作在11.0592MHz时钟下,其数据线上的数据速率就是11.0592Mbps;也有些特殊的场合采用DDR方式(DoubleDataRate)采样,数据速率是其时钟工作频率的2倍,比如某DDR4内存芯片,其工作时钟是1333MHz,其数据速率是2666Mbps。还有些高速传输的情况,比如PCle、USB3.0、SATA、RapidIO、100G以太网等总线,时钟信息是通过编码嵌入在数据流中,这种情况下虽然在外部看不到有专门的时钟传输通道,但是其工作起来仍然有特定的数据速率。眼图测试数字信号测试系列数字信号带宽、信道带宽、信息速率、基带、频带的带宽;

数字信号的时域和频域
数字信号的频率分量可以通过从时域到频域的转换中得到。首先我们要知道时域是真实世界,频域是更好的用于做信号分析的一种数学手段,时域的数字信号可以通过傅里叶变换转变为一个个频率点的正弦波的。这些正弦波就是对应的数字信号的频率分量。假如定义理想方波的边沿时间为0,占空比50%的周期信号,其在傅里叶变换后各频率分量振幅。
可见对于理想方波,其振幅频谱对应的正弦波频率是基频的奇数倍频(在50%的占空比下)。奇次谐波的幅度是按1"下降的(/是频率),也就是-20dB/dec(-20分贝每十倍频)。
为了保证接收端在时钟有效沿时采集到正确的数据,通常都有建立/保持时间的要求,以避免采到数据线上跳变时不稳定的状态,因此这种总线对于时钟和数据线间走线长度的差异都有严格要求。这种并行总线在使用中比较大的挑战是当总线时钟速率超过几百MHz后就很难再提高了,因为其很多根并行线很难满图1.15并行总线的时钟传输足此时苛刻的走线等长的要求,特别是当总线上同时挂有多个设备时。为了解决并行总线工作时钟频率很难提高的问题,一些系统和芯片的设计厂商提出了嵌入式时钟的概念。其思路首先是把原来很多根的并行线用一对或多对高速差分线来代替,节省了布线空间;然后把系统的时钟信息通过数据编码的方式嵌在数据流里,省去了专门的时钟走线。信号到了接收端,接收端采用相应的CDR(clock-datarecovery)电路把数据流中内嵌的时钟信息提取出来再对数据采样。图1.16是一个采用嵌入式时钟的总线例子。数字信号上升时间是示波器中进行上升时间测量例子,光标交叉点指示出上升时间测量的起始点和结束点的位置;

对于一个理想的方波信号,其上升沿是无限陡的,从频域上看 它是由无限多的奇数次谐波构成的,因此一个理想方波可以认为是无限多奇次正弦谐波 的叠加。
但是对于真实的数字信号来说,其上升沿不是无限陡的,因此其高次谐波的能量会受到 限制。比如图1.3是用同一个时钟芯片分别产生的50MHz和250MHz的时钟信号的频 谱,我们可以看到虽然两种情况下输出时钟频率不一样,但是信号的主要频谱能量都集中在 5GHz以内,并不见得250MHz时钟的频谱分布就一定比50MHz时钟的大5倍。 数字信号电平范围象征的逻辑状态;海南数字信号测试价目表
数字信号有哪些出来方式;海南数字信号测试价目表
简单的去加重实现方法是把输出信号延时一个或多个比特后乘以一个加权系数并和 原信号相加。一个实现4阶去加重的简单原理图。
去加重方法实际上压缩了信号直流电平的幅度,去加重的比例越大,信号直流电平被压缩得越厉害,因此去加重的幅度在实际应用中一般很少超过-9.5dB。做完预加重或者去加重的信号,如果在信号的发送端(TX)直接观察,并不是理想的眼图。图1.31所示是在发送端看到的一个带-3.5dB预加重的10Gbps的信号眼图,从中可以看到有明显的“双眼皮”现象。 海南数字信号测试价目表
基本上可以看到数字信号的频域分量大部分集中在1/7U,这个频率以下,我们可以将这个频率称之为信号的带宽,工程上可以近似为0.35/0,当对设计要求严格的时候,也可近似为0.5/rro 也就是说,叠加信号带宽(0.35/。)以下的频率分量基本上可以复现边沿时间是tr的数字时;域波形信号。这个频率通常也叫作转折频率或截止频率(Fknee或cutofffrequency) *信号的能量大部分集中在信号带宽以下,意味着我们在考虑这个信号的传输效应时,主要关注比较高频率可以到信号的带宽。 所以,假如在数字信号的传输过程中可以保证在信号的带宽(0.35亿)以下的频率分量(模拟信号)经...